fpga

    5गर्मी

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    एफपीजीए में छद्म यादृच्छिक संख्या कैसे उत्पन्न करें?

    6गर्मी

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    एक क्षेत्र कुशल सर्किट कि 4-इनपुट LUTs (देखो-अप टेबल) का उपयोग कर 15-बिट इनपुट में सेट बिट्स की संख्या की गणना कैसे बनाएं। आउटपुट स्पष्ट रूप से 4-बिट (0-15 की गणना करता है) है। कुछ का दावा है कि 9 एलय

    6गर्मी

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    प्रोग्राम करने का सबसे तेज़ तरीका मैं xilinx fpga पर माइक्रोब्लैज़ माइक्रोप्रोसेसर के आस-पास एक माइक्रो नियंत्रक डिज़ाइन कर रहा हूं। अधिकांश हार्डवेयर सेटअप किया जाता है। मैं इस बिंदु पर अद्यतन कर रहा

    7गर्मी

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    मैं Verilog के लिए नया हूँ। क्या कोई सीखने का संसाधन, पुस्तक, वीडियो, ब्लॉग या कुछ भी सुझा सकता है जिसके साथ उनका अच्छा व्यक्तिगत अनुभव था और उन्हें तेज़ी से सीखने में मदद मिली? यदि यह मदद करता है, मै

    11गर्मी

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    पर यादृच्छिक संख्या पीढ़ी मुझे स्पार्टन -3 ई एफपीजीए पर अपने अनुवांशिक एल्गोरिदम के लिए छद्म-यादृच्छिक संख्याएं उत्पन्न करने की आवश्यकता है और मैं इसे verilog में कार्यान्वित करना चाहता हूं: क्या आप म

    25गर्मी

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    पर CPUs पर हावी है, मेरे अधिकांश जीवन के लिए, मैंने सीपीयू प्रोग्राम किए हैं; और हालांकि अधिकांश एल्गोरिदम के लिए, बड़े-ओह चलने का समय सीपीयू/एफपीजीए पर समान रहता है, स्थिरांक काफी अलग होते हैं (उदाहर

    6गर्मी

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    के साथ एफपीजीए की तुलना मेरे पास एक मौलिक सवाल है। मैंने कुछ मीडिया एप्लिकेशन और के लिए कुछ एफपीजीए छवि बनाई है, अब मैं अपने परिणामों की तुलना प्रदर्शन & क्षेत्र के संदर्भ में उसी एल्गोरिदम के एएसआईसी

    6गर्मी

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    प्रोग्रामिंग एफपीजीएएस के लिए, क्या यह अपना खुद का स्थान & मार्ग दिनचर्या लिखना संभव है? [मुद्दा यह नहीं है कि मेरा बेहतर होगा; मुद्दा यह है कि क्या मुझे ऐसा करने की आजादी है] - या जगह & रूट स्टेज आउट

    16गर्मी

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    जोड़ने में त्रुटि मैं एक साधारण मॉड्यूल चाहता हूं जो दो std_logic_vectors जोड़ता है। हालांकि, + ऑपरेटर के साथ नीचे कोड का उपयोग करते समय यह संश्लेषित नहीं करता है। library IEEE; use IEEE.std_logic_11

    8गर्मी

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    मैं एफपीजीए प्रोग्रामिंग शुरू करना चाहता हूं। मुझे इस बारे में कोई जानकारी नहीं है कि एफपीजीए कैसे काम करते हैं और इस तरह। मैं एक विकास बोर्ड प्राप्त करना चाहता हूं, बहुत महंगा नहीं, लेकिन इसमें कम से